Sightsys – test program development services for your electronic boards

For more information:

Zvika Almog




– אנו מפתחים ומייצרים התקנים מכניים לשלב יצור סדרתי, כאשר

   הכרטיס מונח על מיטת סיכות וננעל ע”י מכסה ההתקן הייעודי – JIG.


– לחילופין אנו מציעים פתרונות לבדיקת כרטיסים אלקטרונים בתצורת

   “על השולחן”, ללא התקן מכני, כך שהכרטיס , המחברים

   והמודולים הנלווים, פרוסים על השולחן ללא התקן מכני ייעודי.


Functional testing and/or In-Circuit programming

– בניית התקן מכני (ג’יג) – test fixture, אשר יונח בתוכן הכרטיס הנבדק ע”ג מיטת סיכות ומסביבו ימוקמו כל המודולים הדרושים לבדיקות פונקציונאליות וצריבות תוך-כרטיס.

– טעינת קובצי תכנים לוגיים שונים לFPGA אשר בכרטיס הנבדק לשם הפעלת הרכיב להרצת בדיקות פונקציונאליות שונות בכרטיס.

– כתיבת מערכי בדיקה, שליטה ובקרה על מערכות הבדיקה השונות, כתיבת סקריפטים ועיצוב ממשקים גראפיים להפעלת הפונקציות השונות. 


סאייטסיס מפתחת ומייצרת התקנים מכניים:

– מיטת סיכות – התממשקות מהירה לכרטיס הנבדק

– מינימום בלאי של מחברים, צמות וכו’

– מגע ע”י סיכות – הרחבת בדיקות ומדידות חשמליות של נטים פנימיים

– שילוב מודולי חומרה חיצונים שונים לבדיקות וצריבות

– בדיקת מחברים ללא צמות ישירות או באמצעות כרטיסים פורסים

– שילוב מנגנוני תכניות ויישום בדיקות פונקציונאליות מוכנות של הלקוח

– בדיקה וצריבה של פנל (pallet) – multiple DUT boards 


Design for Testability Review

Sightsys can provide you with design consultation and an analysis of your design for  boundary-scan testability. We will review your design and make specific recommendations that if implemented will improve the testability. We can also suggest improvements that will increase test coverage and allow boundary-scan to be implemented in a more cost-effective manner.

This service also includes a test coverage analysis that we recommend to do after schematic capture and before PCB layout. At this stage of product development, Sightsys provides you with a comprehensive test coverage reports that identifies all of the boundary-scan nets and pins and classifies them as completely tested, partially tested, or not tested. The report also recommends where to add test points (pads) for physical “nails” access if additional test coverage is required.


Test Fixtures & Boundary-Scan/Functional testing integration.

In-Circuit / Gang Programming for mass production.

 Test fixtures offer a versatile way to maximize testability. When designed properly, a test fixture can be reused at multiple test stages, including boundary-scan, ICT and functional. For boundary-scan testing, fixtures offer means to combine multiple boundary-scan chains together, add voltage level shifters, interface to external connectors for increased test coverage, and even test multiple boards simultaneously.

Sightsys can help specify boundary-scan requirements for existing fixtures or can help move the test fixture development process from start to finish by working with our Test Fixture Israeli workshops Partners. Both single unit and multiple unit fixtures are supported to satisfy any level of manufacturing volume.

Sightsys has developed add-on modules for analog signal testing, I/Os connection testing and other modules which can be integrated with the Test Fixture in order to expand test coverage of a given board beyond a standard  boundary-scan technology.


On-site Training Classes and Support

Sightsys is able to provide the training class that includes a boundary-scan tutorial and hands-on lab exercises using Corelis ScanExpress hardware and software. Customers also have the option to custom tailor the training class to meet their specific requirements. 

The training includes a combination of lectures, demonstrations, and hands-on exercises using actual hardware to provide you with an overview of ScanExpress test and ISP features and to have you run your own developed test procedures.

What will you be able to do upon completion of the class?

Upon completion of the training you will be able to correctly implement boundary-scan DFT and ISP facilities into your new designs. You will also be able to develop boundary-scan test procedures on your own as well as in-system programming files for CPLDs and Flash memories.

Topics covered in the class include:

  • Introduction to boundary-scan

  • Design for boundary-scan testability Guidelines

  • Design for boundary-scan In-System Programming Strategy

  • Test generation and testing methods for boundary-scan-based designs

    • Test program generation methodology

    • Test program execution plan

    • Test program interactive debugging concepts

  • At-speed embedded functional testing using an on-board JTAG-based CPU

  • In-system programming of CPLDs and Flash memories tutorial

  • Hands-on individual lab exercises using real units under test (UUTs) that will teach you:

    • How to generate and execute interconnect tests

    • How to test memory interconnects

    • How to test logic clusters

    • How to use an embedded processor’s JTAG port for embedded functional testing

    • How to program CPLDs and Flash memories in circuit

    • How to troubleshoot a test procedure

You will become familiar with the entire Corelis ScanExpress product family



Embedded IDE tools – C/C++ Compilers and DebuggersReal Time Operating SystemsDebuggers & JTAG EmulatorsEmbedded Software Testing solutionsMiddleware & SW componentsHW Testing solutions – Boundary-Scan (JTAG) & FunctionalOrganizing, Analyzing & Verification tools for HDL designs, FPGAs, Board schematic, PCB layout and Systems designersHome of CANopen, EtherCAT, PowerLink, ProfiNet– SW Protocols, Data loggers, Interfaces, devices & SolutionsIn-Circuit/Parallel Engineering & Production Device Programmers (Flash/EPROMs/CPLDs…)

For more information: Zvika Almog 054-2101400